THS8083APZP datasheet(44/64 Pages) TI

部品番号	THS8083APZP

部品情報	TRIPLE 8 BIT 80 MSPS 3.3V VIDEO AND GRAPHICS

PDF	64 Pages

Scroll/Zoom	100%

メーカー	TI [Texas Instruments]

ホームページ	http://www.ti.com

Logo

44 / 64 page

4–4

4.4

Timing Diagram—48-Bit Parallel Mode

This mode allows a double-pixel width output interface with no time offset between buses A and B. The DATACLK1

output is at half of the sampling clock frequency. Data on output bus A precedes data on output bus B.

Last Samples From Previous Line

DATACLK

CH1_OUTA[7..0]

CH2_OUTA[7..0]

CH2_OUTB[7..0]

CH1_OUTB[7..0]

CH3_OUTA[7..0]

CH3_OUTB[7..0]

DHS

tdlh(OE)

tdhl(OE)

tsu(DHS)

th(DHS)

tsu(OUT)

(DHS_POL = 0

Assumed-Inverted

Polarity Otherwise)

<DHS_MODE> = 1 –> Width

Equal to Width of HS Input

<DHS_MODE> = 0 –> DHS

Width is 1 ADCCLK2 Period

7 ADCCLK2

Cycles Latency

pix 01

pix 02

ADCCLK1

Last Samples From Previous Line

th(OUT)

Last Samples From Previous Line

7 ADCCLK2 Cycles Latency

THS8083APZP データシート(PDF) 44 Page - Texas Instruments

THS8083APZP データシート(HTML) 44 Page - Texas Instruments

Html Pages

1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63 64

データシートダウンロード

リンク URL

THS8083APZP データシート(PDF) 44 Page - Texas Instruments

THS8083APZP データシート(HTML) 44 Page - Texas Instruments

Html Pages

1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63 64

データシート ダウンロード

リンク URL

データシートダウンロード