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HD151TS206SS データシート(PDF) 32 Page - Renesas Technology Corp |
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32 / 34 page ![]() HD151TS206SS Rev.1.00, Apr.28.2003, page 32 of 34 Clock Out tcycle n t = (tcycle n) - (tcycle n+1) CCS tcycle n+1 Fig.1 Cycle to Cycle Jitter (3.3V Single Ended Clock Output) Clock Outx Clock Outy 1.5 V tskS 1.5 V Fig.2 Output Clock Skew (3.3V Single Ended Clock Output) RP = 49.9 Ω RP = 49.9 Ω ZLT = ZLC = 50 Ω RS = 33.2 Ω CPU LT CPU# TS206 CL = 2 pF CL = 2 pF RS = 33.2 Ω LC RI(ref) = 475 Ω Fig.3 Load Circuit for CPU/CPU# |
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