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3 / 22 page ![]() 74LVC2G240 All information provided in this document is subject to legal disclaimers. © NXP B.V. 2013. All rights reserved. Product data sheet Rev. 8 — 8 April 2013 3 of 22 NXP Semiconductors 74LVC2G240 Dual inverting buffer/line driver; 3-state 5. Functional diagram 6. Pinning information 6.1 Pinning Fig 1. Logic symbol Fig 2. IEC logic symbol 001aah782 1A 2Y 1Y 1OE 2A 2OE EN EN 001aah783 Fig 3. Pin configuration SOT505-2 and SOT765-1 Fig 4. Pin configuration SOT833-1, SOT1089, SOT1116 and SOT1203 74LVC2G240 1OE VCC 1A 2OE 2Y 1Y GND 2A 001aaf075 1 2 3 4 6 5 8 7 74LVC2G240 1Y 2OE VCC 2A 2Y 1A 1OE GND 001aaf076 36 27 18 45 Transparent top view |
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