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OMAP3530ECBC72 データシート(PDF) 178 Page - Texas Instruments

部品番号 OMAP3530ECBC72
部品情報  OMAP3530/25 Applications Processor: OMAP 3 Architecture
PDF  264 Pages
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メーカー  TI1 [Texas Instruments]
ホームページ  http://www.ti.com
Logo TI1 - Texas Instruments

OMAP3530ECBC72 データシート(HTML) 178 Page - Texas Instruments

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T
T
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T
T
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T
BA0
BA1
A0
A14
CS
CAS
RAS
WE
CKE
CK
CK
T
T
T
T
T
T
T
T
OMAP35x
DQ0
DQ7
DM0
DQS0
DQ8
DQ15
DM1
DQS1
LPDDR
DQ16
DQ23
DM2
DQS2
DQ24
DQ31
DM3
DQS3
N/C
N/C
sdrc_ncs1
sdrc_cke1
OMAP3530/25 Applications Processor
SPRS507F – FEBRUARY 2008 – REVISED OCTOBER 2009
www.ti.com
Figure 6-18. OMAP35x LPDDR High Level Schematic (x32 memory)
6.4.2.2.2 Compatible JEDEC LPDDR Devices
Table 6-13 shows the parameters of the JEDEC LPDDR devices that are compatible with this interface.
Generally, the LPDDR interface is compatible with x16 and x32 LPDDR266 and LPDDR333 speed grade
LPDDR devices.
Table 6-13. Compatible JEDEC LPDDR Devices
NO.
PARAMETER
MIN
MAX
UNIT
NOTES
JEDEC LPDDR Device Speed
1
LPDDR-266
See Note (1)
Grade
2
JEDEC LPDDR Device Bit Width
16
32
Bits
3
JEDEC LPDDR Device Count
1
2
Devices
See Note (2)
JEDEC LPDDR Device Ball
4
60
90
Balls
Count
(1)
Higher LPDDR speed grades are supported due to inherent JEDEC LPDDR backwards compatibility.
(2)
1 x16 LPDDR device is used for 16 bit LPDDR memory system. 1x32 or 2x16 LPDDR devices are used for a 32-bit LPDDR memory
system.
TIMING REQUIREMENTS AND SWITCHING CHARACTERISTICS
178
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